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P3室內全彩屏單元
在P3室內高清全彩led顯示屏等顯示系統對數據輸出速度的要求日益提高的背景下，當前對控制設備進行改造的過程中，首選的辦法是更換更高速率的微處理器，而對硬件電路的挖潛往往容易被忽視。
在實踐運用中，建議應先考慮在原有的系統上進行硬件電路改造，如仍不能滿足顯示要求，可再考慮更換高速率微處理器及用FPGA/ CPLD 器件進行輸出電路替代處理的方案。本文以P3室內高清全彩led顯示屏控制電路為例，提出了一種在硬件電路改造上提高顯示數據輸出速度的實現辦法。
在P3室內高清全彩led顯示屏的顯示過程中，讀取數據頻繁，且隨著顯示面積的增加與色彩變化的豐富，對數據輸出速度的要求越來越高。普通方式讀取一個字節的RAM 數據，至少需要兩個機器周期，即24 T (時鐘周期)。而使用SPI 方式，數據的輸出速度由SPSCK(最高可設置為f OSC的1/ 4) 決定，而普通方式讀RAM 的速度只有1/ 24 f OSC ,即在SPI 模式下，此LED大屏幕電路的數據輸出速度最大可提高6 倍。通過此方法對輸出電路進行改造，可極大地使原有控制系統滿足數據高速輸出的要求。本文給出的例子雖是基于P3室內高清全彩led顯示屏應用的，但在LCD 或是其他對數據有高速輸出要求的系統中，同樣具有借鑒運用意義。
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